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ZEROPLUS臺(tái)灣孕龍邏輯分析儀
LAP-B(70256L)邏輯分析儀已停產(chǎn)，軟件持續(xù)更新, 服務(wù)不打烊
LAP-B(702000X)邏輯分析儀可代替停產(chǎn)產(chǎn)品：LAP-B(702000Z)，LAP-B(702000+)，LAP-B(702000)，LAP-B(702000L)，LAP-B(70256)，LAP-B(70256L)。
特點(diǎn):
時(shí)序量測(cè)取樣頻率:100Hz~400MHz
內(nèi)存容量:17.5Mbits
每信道記憶深度:256Kbits
觸發(fā)通道:70CH
數(shù)據(jù)壓縮:最大128Kbits x 4G
觸發(fā)階層:9階
指定封包觸發(fā):YES
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Free - |
IIC、UART、SPI、7-SEGMENT LED |
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Option - |
1-WIRE、3-WIRE、AC97、ARITHMETIC LOGIC、CAN 2.0B、CCIR656、DIGITAL LOGIC、DIGRF、DMX512、DSA、FLEXRAY 2.1A、HDQ、I2C(EEPROM 24LX)、IIS、IRDA、ISO7816 UART、JK FLIP-FLOP、JTAG 2.0、LCD 12864、LCD1602、LIN 2.1、LPC、LPC-SERIRQ、MANCHESTER、MCU-51 DECODE、MICROWIRE、MII、MILLER、MOD、MODIFIED MILLER、NEC PD6122、PCI、PCM、PECI、PM 1.1、PS/2、PSB、S/PDIF、SD2.0/SDIO、SDQ、SIGNIA 6210、SLE4442、SM 2.0、SSI、ST、ST7669 、UP DOWN COUNTER、USB 1.1 |
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【 產(chǎn)品規(guī)格 】LAP-B(70256L)邏輯分析儀 |
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取樣頻率 |
內(nèi)部(時(shí)序)(異步) 100Hz~400MHz
外部(狀態(tài))(同步) 150MHz |
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待測(cè)信號(hào) |
頻寬: 100MHz
觸發(fā)電壓范圍: -6V~+6V
觸發(fā)電壓分辨率: ±0.1V |
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內(nèi)存 |
內(nèi)存容量: 17.5Mbits
每信道內(nèi)存深度: 256Kbits |
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觸發(fā) |
觸發(fā)方式: Pattern/Edge/Wide/AND/OR
觸發(fā)通道: 70CH
預(yù)先/延后觸發(fā): YES
觸發(fā)階層: 9階
多次觸發(fā): 1~65535 |
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支持系統(tǒng) |
Windows (98SE/ME/2000/XP/Vista) |
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傳輸接口 |
USB2.0(1.1) |
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軟件功能 |
操作接口語言: 中(簡(jiǎn)體/繁體) / 英文
時(shí)基范圍: 5ps~10Ms
波形垂直縮放比例: 1~5.5
波形數(shù)據(jù)壓縮: 最大128Kbits x 4G
波形觸發(fā)分頁(yè)最大值: 1~8192頁(yè)
濾波功能及濾波功能延遲: YES
波形寬度顯示: YES
波形觸發(fā)延遲: YES
可增加定位棒: YES
定位棒自動(dòng)貼近功能: YES
軟件自動(dòng)升級(jí): YES
可選擇分析數(shù)據(jù)的范圍: YES
資料統(tǒng)計(jì): YES
自動(dòng)存檔: YES
濾波器分隔棒: YES
串行協(xié)定分析: YES
數(shù)據(jù)比對(duì): YES
總線Latch功能: YES
總線封包列表功能: YES
封包列表匯出功能: YES
串行封包觸發(fā): YES |
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其它 |
相位誤差< 1.5ns
電源AC100~240V , 50~60Hz
最大輸入電壓±30V
輸入阻抗500KΩ / 10pF
安規(guī)認(rèn)證FCC / CE
產(chǎn)品體積250mm * 170mm * 47mm |
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【 電氣規(guī)格 】LAP-B(70256L)邏輯分析儀 |
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項(xiàng)目 |
Min |
Type |
Max |
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工作電壓 |
– |
AC 110/220 V |
– |
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電流消耗(閑置狀態(tài)) |
– |
45.4mA/23mA |
– |
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電流消耗(工作狀態(tài)) |
– |
89.6mA/45mA |
– |
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功率消耗(閑置狀態(tài)) |
– |
5W |
– |
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功率消耗(工作狀態(tài)) |
– |
9.86W |
– |
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相位誤差 |
– |
– |
± 1.5 nS |
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最大輸入電壓 |
– |
– |
± DC 30 V |
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觸發(fā)準(zhǔn)位 |
DC-6V |
– |
DC+6V |
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輸入阻抗 |
– |
500KΩ/10pF |
– |
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工作溫度 |
5°C |
– |
70°C |
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存放溫度 |
-40°C |
– |
80°C |
產(chǎn)品特色:
具有外部按鈕執(zhí)行邏輯分析儀取樣功能
在LAP-B(70256L) 邏輯分析儀的硬件上，有一個(gè)START的按鈕，當(dāng)邏輯分析儀軟件在開啟的狀態(tài) ，可利用此按鈕來讓邏輯分析儀執(zhí)行取樣的動(dòng)作。此按鈕能讓您更快速的操作邏輯分析儀取得被測(cè)物的資料。
壓縮技術(shù)
孕龍LAP-B(70256L)邏輯分析儀加入了波形壓縮的專利技術(shù)，壓縮顧名思義可以了解是將被測(cè)物的訊號(hào)做實(shí)時(shí)且不損失數(shù)據(jù)的壓縮，壓縮的目的是將有限的記憶空間透過壓縮的技術(shù)得到比實(shí)際硬件記憶容量還大的數(shù)據(jù)，壓縮技術(shù)的加入可讓您獲得更多的取樣數(shù)據(jù)，數(shù)據(jù)的分辨率更高且不失寶貴的記憶空間。
LAP-B(70256L)的壓縮率達(dá) 倍，當(dāng)記憶容量選擇在256K時(shí)，最大可擷取的資料量達(dá)128K x 2^31Bits(Per Channel) ，當(dāng)然壓縮率會(huì)隨著被分析的數(shù)據(jù)內(nèi)容而定。
Enable (限定子)
孕龍LAP-B(70256L)邏輯分析儀加入了波形限定的技術(shù)，Enable(限定子)的功能是將輸入的被測(cè)信號(hào)，利用一可設(shè)定的信道信號(hào)的判斷電路，來過濾掉不需要的信號(hào)，可達(dá)到充分利用內(nèi)存存放有價(jià)值的被測(cè)信號(hào)。
當(dāng)輸入的各個(gè)信道的信號(hào)組合符合我們所設(shè)定限定子Enable 的數(shù)據(jù)組合時(shí)，此段的數(shù)據(jù)是可以讓邏輯分析儀取樣并存入內(nèi)存中，待存放結(jié)束后再傳回計(jì)算機(jī)中的邏輯分析儀軟件作顯示，而當(dāng)輸入的各個(gè)信道的信號(hào)組合不符合我們所設(shè)定限定子Enable 的數(shù)據(jù)組合時(shí)此段的數(shù)據(jù)是不會(huì)讓邏輯分析儀取樣并且不會(huì)存入內(nèi)存中，當(dāng)邏輯分析儀存放結(jié)束后A傳回計(jì)算機(jī)中的邏輯分析儀軟件作顯示，顯示的數(shù)據(jù)中是不會(huì)包含此段的資料。
Enable Delay(限定子延遲)
孕龍LAP-B(70256L)邏輯分析儀加入了波形限定延遲的專利技術(shù)，Enable Delay 是將Enable的效果予以延長(zhǎng)或縮短時(shí)間，利用Enable Delay 的設(shè)定值可以將原來Enable 的設(shè)定的區(qū)域予以變換為Enable 的反向區(qū)域，或是將Enable 的區(qū)域縮短或延長(zhǎng)，或是反向的區(qū)域縮短或延長(zhǎng)。
Trigger Page(分頁(yè)技術(shù))
孕龍LAP-B(70256L)邏輯分析儀加入了Trigger 分頁(yè)的專利技術(shù)，Trigger Page 簡(jiǎn)短的說明就是將您的數(shù)據(jù)分頁(yè)。
以目前所選擇的內(nèi)存長(zhǎng)度為一頁(yè)，觸發(fā)點(diǎn)的所在頁(yè)即為第一頁(yè)，分析完第一頁(yè)的數(shù)據(jù)后，只要被測(cè)物的數(shù)據(jù)每一次都是相同的，且觸發(fā)狀態(tài)的設(shè)定不變，就可以將Trigger Page設(shè)為2再重新啟動(dòng)邏輯分析儀，待邏輯分析儀停止擷取數(shù)據(jù)且完成顯示時(shí)，波形顯示區(qū)內(nèi)的內(nèi)容即為第二頁(yè)的數(shù)據(jù)，第二頁(yè)的數(shù)據(jù)就是緊接著第一頁(yè)后的數(shù)據(jù)。
Trigger Count(觸發(fā)次數(shù)計(jì)算)
孕龍LAP-B(70256L)邏輯分析儀加入了Trigger Count的技術(shù)，Trigger Count的功能是將有一個(gè)以上符合觸發(fā)值的被測(cè)信號(hào)，您可以決定您的觸發(fā)點(diǎn)是要在第幾個(gè)符合觸發(fā)設(shè)定的點(diǎn)作觸發(fā)，第一次碰到觸發(fā)的設(shè)定狀態(tài)時(shí)就觸發(fā)時(shí)，這個(gè)Trigger Count就要設(shè)定為1(預(yù)設(shè))，第二次碰到觸發(fā)的設(shè)定狀態(tài)時(shí)才觸發(fā)時(shí)，這個(gè)Trigger Count就要設(shè)定為2，以此類推Trigger Count 最大可設(shè)至65535次。一個(gè) pod 是邏輯分析儀的連接量測(cè)通道的收集端點(diǎn)。
真實(shí)時(shí)間觸發(fā)
孕龍LAP-B(70256L)邏輯分析儀的觸發(fā)判斷使用1個(gè)Clock就可判斷出
Rising Edge：前一個(gè)Clock是Low，這一個(gè)Clock 是High
Falling Edge：前一個(gè)Clock是High，這一個(gè)Clock是Low
Rising Edge or Falling Edge：前一個(gè)Clock是Low，這一個(gè)Clock是High (Rising Edge )，或是前一個(gè)Clock是High，這一個(gè)Clock是Low(Falling Edge)，這二種狀態(tài)的其中一種都符合這個(gè)Trigger的設(shè)定。
High Level：當(dāng)其它的量測(cè)通道的Trigger有設(shè)定Rising Edge、Falling Edg或是Rising or Falling Edge 時(shí)必須要維持 二個(gè)Clock的取樣，都是High 才是符合High Level，然而其它量測(cè)通道的Trigger沒有設(shè)定Rising Edge、Falling Edge或 Rising or Falling Edge 時(shí)只要一個(gè)Clock取樣為High時(shí)這個(gè)信道的信號(hào)就符合Trigger 的這個(gè)通道的設(shè)定。
Low Level ：當(dāng)其它的量測(cè)通道的Trigger有設(shè)定Rising Edge 、 Falling Edg或是Rising or Falling Edge時(shí)必須要維持二個(gè)Clock的取樣都是High 才是符合Low Level，然而其它量測(cè)通道的Trigger沒有 設(shè)定Rising Edge、 Falling Edge或 Rising or Falling Edge 時(shí)只要一個(gè)Clock取樣為Low時(shí)這個(gè)信道的信號(hào)就符合Trigger的這個(gè)通道的設(shè)定。
High Level or Low Level ：讓Trigger 能夠找到瞬間出現(xiàn)的波形信號(hào)，這個(gè)波形可能是系統(tǒng)上的問題，藉由LAP-32128U-A可幫助您抓到問題的所在。邏輯分析儀的一個(gè)量測(cè)信道是一根輸入邏輯分析儀的信號(hào)連接線。每一個(gè)量測(cè)通道負(fù)責(zé)連接到被測(cè)裝置的一個(gè)引腳進(jìn)行量測(cè)，每個(gè)量測(cè)通道被用于從被測(cè)物采集信號(hào)的信道。
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