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    LAP-C(16128)邏輯分析儀
      廠商:ZEROPLUS臺灣孕龍 [打印此頁]

     

    ZEROPLUS臺灣孕龍邏輯分析儀
    LAP-C(16128)邏輯分析儀

    LAP-C(16128)邏輯分析儀可代替LAP-16128U,LAP-16128U停產(chǎn)。
    特點:
    .內(nèi)部取樣頻率:100Hz200MHz
    .內(nèi)存容量:4Mbits
    .每信道內(nèi)存深度:128Kbits
    .觸發(fā)通道 16CH
    PC-Based界面
    .采USB1.1(2.0)傳輸供電

    Free -

    7-SEGMENT LED、IIC、SPIUART

    Option -

    1-WIRE、3-WIRE、AC97、ARITHMETIC LOGIC、CAN 2.0B 、CCIR656DIGITAL LOGIC、DIGRF、DMX512DSA、FLEXRAY 2.1A、HDQ、IISIRDA、JK FLIP-FLOPJTAG 2.0、LCD 12864、LCD1602、LIN 2.1、LPC、LPC-SERIRQ、MANCHESTER、MICROWIREMII、MILLERMOD、NEC PD6122、PCMPECI、PM 1.1、PS/2、PSB、S/PDIFSD2.0/SDIO、SIGNIA 6210SLE4442、SM2.0、SSISTST7669、USB 1.1 、LAP-PCI-MUPDOWNCOUNTER、MODIFIED MILLER、ISO7816 UART

     

    產(chǎn)品規(guī)格 LAP-C(16128)邏輯分析儀

    取樣頻率

    內(nèi)部(時序)(異步) 100Hz~200MHz
    外部(狀態(tài))(同步) 100MHz

    待測信號

    頻寬 75MHz
    觸發(fā)電壓范圍 -6V~+6V
    觸發(fā)電壓分辨率 ±0.1V

    內(nèi)存

    內(nèi)存容量 4Mbits
    每信道內(nèi)存深度 128Kbits (Max 32Mbits for compression)

    觸發(fā)

    觸發(fā)方式 Pattern/Edge
    觸發(fā)通道 16 CH
    預先/延后觸發(fā) YES
    觸發(fā)階層 1 Level
    多次觸發(fā) 1~65535

    軟件功能

    波形數(shù)據(jù)壓縮 Max 32Mbits
    時基范圍
    波形垂直縮放比例
    操作接口
    波形觸發(fā)分頁最大值
    波形寬度顯示
    波形限定子及延遲
    波形觸發(fā)延遲
    可增加定位棒
    定位棒自動貼進功能
    軟件自動升級
    可選擇分析數(shù)據(jù)的范圍
    資料統(tǒng)計
    自動存檔
    波形限定子分隔棒
    總線分析
    數(shù)據(jù)比對
    總線Latch功能
    總線封包列表功能
    封包列表匯出功能

    電源

    電源USB (DC 5V, 500mA)
    靜態(tài)消耗功率 1W
    瞬間最大消耗功率 2W

    其它

    系統(tǒng)支持 Windows 98SE / ME / 2000 / XP / Vista
    相位誤差 < 1.5ns
    最大輸入電壓 ±30V
    輸入阻抗 500KΩ/10pF
    安規(guī)認證 FCC / CE / WEEE / RoHS

     

    電氣規(guī)格 LAP-C(16128)邏輯分析儀

    項目

    Min

    Type

    Max

    工作電壓

    4.5V

    5V

    5.5V

    靜態(tài)消耗電流

    200mA

    工作消耗電流

    400mA

    靜態(tài)消耗功率

    1W

    工作消耗功率

    2W

    相位誤差

    1.5ns

    量測信道輸入電壓

    -30V

    +30V

    參考電壓

    -6V

    +6V

    輸入阻抗

    500KΩ/10pf

    工作溫度

    5

    70

    儲存溫度

    -40

    80

    產(chǎn)品特色:
    具有外部按鈕執(zhí)行邏輯分析儀取樣功能

    在孕龍邏輯分析儀的硬件上,有一個START的按鈕,當邏輯分析儀軟件在開啟的狀態(tài),可利用此按鈕來讓邏輯分析儀執(zhí)行取樣的動作。此按鈕能讓您更快速的操作邏輯分析儀取得被測物的資料。

    壓縮技術(shù)

    孕龍科技推出波行壓縮專利技術(shù),可以在不增加內(nèi)存的狀況下獲取更長的波形資料。For Example:設定內(nèi)存深度為1M,取樣率為50MHz。未開啟壓縮功能時僅可擷取20.972ms,若開啟壓縮功能后,以同樣記憶深度為1M,取樣率為50MHz進行取樣,則可以將波形時間增加至3.999s,大大的提升了擷取數(shù)據(jù)量。
    信號濾波延遲

    孕龍科技推出了信號濾波延遲專利技術(shù),信號濾波功能可以將訊號進行條件式的擷取,如下圖所述,將A1通道設定濾波條件為高準位,透過上下并列窗口的比較可明顯看出兩者間的差異,而信號濾波延遲則是能夠?qū)⑿盘枮V波的條件更加靈活化,使用者可自行設定過濾的時間狀態(tài)。

    For Example
    :客戶端有一組DUT出現(xiàn)Bug,Bug的內(nèi)容是當程序讀取的時候可能會出現(xiàn)讀取錯誤的情況,此時就可以利用信號濾波延遲進行條件式的擷取,藉此進行Bug分析 (讀取狀態(tài)為0X5A、讀取命令周期為10us)透過信號濾波延遲功能,邏輯分析儀就可以只針對當0X5A的數(shù)值出現(xiàn)后僅擷取命令時間10us,進而分析Bug的發(fā)生問題。
    觸發(fā)分頁技術(shù)

    孕龍邏輯分析儀加入了觸發(fā)分頁(Trigger Page)的專利技術(shù),Trigger Page簡單的說就是將連續(xù)又漫長的訊號數(shù)據(jù)分頁。
    以目前所設定的內(nèi)存長度為一頁,觸發(fā)點的所在即為第一頁,分析完第一頁的數(shù)據(jù)后,只要被測物的數(shù)據(jù)每一次都是相同的,且觸發(fā)狀態(tài)設定不變,就可以將Trigger Page設為2再重新啟動邏輯分析儀,待邏輯分析儀停止擷取數(shù)據(jù)且完成顯示時,波形顯示區(qū)內(nèi)的內(nèi)容即為第二頁的數(shù)據(jù),第二頁的數(shù)據(jù)就是緊接著第一頁結(jié)束后的數(shù)據(jù)。

    For Example
    :設定記憶深度為32K、取樣率為200MHz,設定觸發(fā)分頁為1,所擷取訊號的結(jié)束點為147.465us,而數(shù)據(jù)為0X47的前半段,再以相同記憶深度與取樣率進行擷取,設定觸發(fā)分頁為2時,所擷取訊號開始點為觸發(fā)分頁1時的結(jié)束點147.465us,此時可看見資料0X47的后半段。
    觸發(fā)次數(shù)計算

    孕龍邏輯分析儀加入了觸發(fā)次數(shù)計算(Trigger Counter)的技術(shù),Trigger Counter,的功能是將有一個以上符合觸發(fā)值的被測信號,使用者可決定觸發(fā)點是要在第幾個符合觸發(fā)設定的位置進行觸發(fā),第一次碰到觸發(fā)的設定狀態(tài)時就觸發(fā)Trigger Counter就要設定為1(預設),第三次碰到觸發(fā)的設定狀態(tài)時才觸發(fā)Trigger Counter就要設定為3,依此類推。
    Trigger Counter
    最大可設至65535
    查詢脈波寬度

    孕龍邏輯分析儀加入了查詢脈波寬度功能(Find Pulse Width),查詢脈波寬度功能是可以信道中的波形寬度為搜尋目標進行比較尋找,如某一頻率波形之周期應為4.2us(/負周期各為2.1us),但某些狀況下會造成頻率周期錯亂,此時就可以利用查詢脈波寬度功能將錯誤點標示,提升工程師在進行Debug時的效率。

    總線協(xié)議分析實例 – SPI總線協(xié)議分析譯碼

    孕龍科技的SPI總線分析模塊,可幫助使用者進行SPI總線分析,透過譯碼模塊可將訊號中的Data數(shù)值直接顯示于屏幕上,孕龍科技SPI總線分析模塊提供使用者自行定義Data bit數(shù)長度功能,分析SPI訊號時不會發(fā)生無法譯碼狀況,能夠依照使用需求自行設定1 28bit。

    操作說明:
    SPI總線實際量測步驟1
    將測試線連接至邏輯分析儀訊號連接座上,將測試線另外一端連接至待測物上,依照待測物狀況不同,也可以使用配件內(nèi)的測試鉤來連接待測物。
    步驟2

    依照安裝手冊第三章所述,進行邏輯分析儀設定,設定完成后啟動邏輯分析儀軟件及送出待測物訊號進行擷取,擷取完成如圖所示。

    提示:邏輯分析儀取樣率需高過待測目標頻率四倍以上才能確保訊號正確。
    步驟3

    將訊號歸納成總線,按住鍵盤上的CTRL鍵不放,在信道列表上以鼠標點選要歸納的訊號信道使其反白,選擇完畢后點下鼠標右鍵選擇歸納信號為總線選項,此時信道列表內(nèi)會增加一組所設定的總線。

    提示:進行總線分析時,需依照待測Protocol信道數(shù)來設定總線信道數(shù),如IIC便設定兩個通道,UART設定一個通道。
    步驟4

    在新增的總線上點選鼠標右鍵,選擇總線屬性,再選擇要使用的總線分析模塊,每一種總線分析模塊均有相對應的參數(shù)設定,使用者可在參數(shù)設定中依照待測總線內(nèi)容加以設定。

    提示:孕龍邏輯分析儀SPI總線分析模塊可同時分析SPI中的MOSIMISO,使用時僅需設定兩組SPI總線分析模塊即可。,
    , <, STRONG>步驟5

    完成設定后,軟件模塊會將總線內(nèi)的封包數(shù)值顯示于屏幕上。


    提示:孕龍科技邏輯分析儀軟件還有其它強大功能可幫助使用者進行總線分析,如封包列表顯示、數(shù)據(jù)搜尋、脈波寬度搜尋….等等。

    配件
    主機

    125mm x 92mm x 25mm

    測試線  


    16pin*1 / 8pin*2 / 2pin*1 / 1pin*1

    測試鉤

    36 pieces
    USB線

    安裝光盤

    快速安裝手冊

    攜帶包
     

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